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職位描述：
工作職責(zé):
1. 負(fù)責(zé)三維存儲(chǔ)器 負(fù)責(zé)三維存儲(chǔ)器 數(shù)字 模塊相關(guān)設(shè)計(jì) 以及存儲(chǔ)器算法（讀寫擦除） 以及存儲(chǔ)器算法（讀寫擦除） 以及存儲(chǔ)器算法（讀寫擦除） 的專利風(fēng)險(xiǎn)評(píng)價(jià)與 的專利風(fēng)險(xiǎn)評(píng)價(jià)與 管控；
2. 追蹤三維存儲(chǔ)器相關(guān) 數(shù)字 電路行業(yè)研發(fā)動(dòng)向并挖掘與布局相關(guān)專利；
3. 協(xié)助 r&d 檢索現(xiàn)有技術(shù)，為項(xiàng)目研發(fā)提供參考；
4. 參與電路相關(guān)專利申請(qǐng)審稿及答復(fù)。
任職資格:
1．ee/cs /physics 博士 或碩士 學(xué)位；
2．優(yōu)選研究方向?yàn)?nand 閃存設(shè)計(jì) /驗(yàn)證 /ic 設(shè)計(jì)者 ；
3. 優(yōu)選擁有信號(hào)混合或 數(shù)字集成電路設(shè)計(jì)優(yōu)選擁有信號(hào)混合或 數(shù)字集成電路設(shè)計(jì)優(yōu)選擁有信號(hào)混合或 數(shù)字集成電路設(shè)計(jì)優(yōu)選擁有信號(hào)混合或 數(shù)字集成電路設(shè)計(jì)優(yōu)選擁有信號(hào)混合或 數(shù)字集成電路設(shè)計(jì)邏輯設(shè)計(jì)經(jīng)驗(yàn)者， 邏輯設(shè)計(jì)經(jīng)驗(yàn)者， 熟悉 system -verilog 優(yōu)先 。
4. 優(yōu)選擁有 在 system -verilog 環(huán)境中的子系統(tǒng)和全芯片級(jí)驗(yàn) 證經(jīng)者；
5．優(yōu)選 熟悉從 rtl 到布局的 nand 設(shè)計(jì)流程。
6. 優(yōu)選熟悉專利法和擁有撰寫經(jīng)驗(yàn)者先 。