應(yīng)屆畢業(yè)生
本科
2026-03-01 08:31:55
896人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請仔細(xì)了解后再進(jìn)行投遞！
工作職責(zé):
1、負(fù)責(zé)自主開發(fā)的數(shù)字IP邏輯設(shè)計；
2、負(fù)責(zé)編寫IP規(guī)格書、模塊劃分和架構(gòu)說明書、詳細(xì)設(shè)計說明書；
3、負(fù)責(zé)編寫RTL級源代碼，靜態(tài)檢查設(shè)計規(guī)則，綜合評估設(shè)計指標(biāo)，模塊測試；
4、負(fù)責(zé)IP交付相關(guān)流程；
5、配合算法開發(fā)、SoC測試、驅(qū)動開發(fā)、系統(tǒng)集成工作。
任職資格:
1、統(tǒng)招本科及以上學(xué)歷；工作經(jīng)驗1~2年；有數(shù)字集成電路設(shè)計經(jīng)驗，視頻圖像從業(yè)經(jīng)驗更佳；
2、熟練掌握Verilog，懂SystemVerilog更佳；
3、掌握ASIC開發(fā)流程，了解SoC體系、前后端流程，有FPGA設(shè)計經(jīng)驗更佳；
4、有ISP等圖像處理經(jīng)歷更佳；
5、良好的英語能力。
1、負(fù)責(zé)自主開發(fā)的數(shù)字IP邏輯設(shè)計；
2、負(fù)責(zé)編寫IP規(guī)格書、模塊劃分和架構(gòu)說明書、詳細(xì)設(shè)計說明書；
3、負(fù)責(zé)編寫RTL級源代碼，靜態(tài)檢查設(shè)計規(guī)則，綜合評估設(shè)計指標(biāo)，模塊測試；
4、負(fù)責(zé)IP交付相關(guān)流程；
5、配合算法開發(fā)、SoC測試、驅(qū)動開發(fā)、系統(tǒng)集成工作。
任職資格:
1、統(tǒng)招本科及以上學(xué)歷；工作經(jīng)驗1~2年；有數(shù)字集成電路設(shè)計經(jīng)驗，視頻圖像從業(yè)經(jīng)驗更佳；
2、熟練掌握Verilog，懂SystemVerilog更佳；
3、掌握ASIC開發(fā)流程，了解SoC體系、前后端流程，有FPGA設(shè)計經(jīng)驗更佳；
4、有ISP等圖像處理經(jīng)歷更佳；
5、良好的英語能力。
注：聯(lián)系我時，請說是在四川人才網(wǎng)上看到的。
工作地點
地址：上海徐匯區(qū)宜山路717號2號樓6樓
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詳細(xì)位置，可以參考上方地址信息
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職位發(fā)布者
HR
上海富瀚微電子股份有限公司
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上海上海徐匯區(qū)上海市徐匯區(qū)華鑫中心2號樓(宜山路717號)6樓
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